디지털논리 verilog이용 full adder(전가산기)구현 (Max2 Plus)-추가구현:nand-nand 로 만든 full adder

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소개글	Veliog를 이용하여, full adder 구현 3개의 입력input x,y,z과 2개의 ouput s,c 로 이루어진 3비트에 대한 산술적 합을 만들어내는 조합회로이다. -------(본문내용생략) 디지털논리 verilog이용 full adder(전가산기)구현 추가구현:nand-nand 로 만든 full adder graphic Editor/ text Editor 두가지로 구현되어있구요, 시뮬레이터 동작(캡쳐)이 자세히 설명되어있습니다 ^^

컴파일 실행환경	Max2plus

참고자료	참고자료 없음

학교정보	2주간 다운받은 학생의 학교정보를 보여줍니다.(5P 소요)



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